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SG6848做反激時 占空比有一個小毛刺

我用SG6848做了一個60W的反激電源。但是發(fā)現(xiàn)GATE的驅動波形中有一個小毛刺。如圖所示 

 

還有一個問題就是，在低壓的時候，占空比嚴重超出了預期。設計的時候工作電壓是85V-265，最大占空比0.4。但是直到電壓上升到140V的時候，占空比才達到0.4然后電壓越高占空比越低。但是在120V的時候占空比居然有0.55左右。更加不敢想象85V的時候的占空比了

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2011-04-21 15:01

我在測試前級采樣電阻的時候，發(fā)現(xiàn)這個G極的波形占空比與這個采樣電阻的波形占空比一樣。采樣電阻的波形中也有一個小毛刺

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asouth
LV.8
3
2011-04-22 10:00
@ope8363744
我在測試前級采樣電阻的時候，發(fā)現(xiàn)這個G極的波形占空比與這個采樣電阻的波形占空比一樣。采樣電阻的波形中也有一個小毛刺

是不是有干擾信號進去了？PCB布局怎么樣？

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liuhou
LV.9
4
2011-04-22 11:57
這個是典型的大小波問題，你看下VDS是不是也是這樣子。
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2011-04-22 15:22
@asouth
是不是有干擾信號進去了？PCB布局怎么樣？
我把電流做小  這個毛刺就能消除。。。。
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2011-04-22 15:23
@liuhou
這個是典型的大小波問題，你看下VDS是不是也是這樣子。
 我把G級的驅動電阻從100改成10   毛刺還是有，但是毛刺的峰值明顯減小了很多。
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2011-04-22 16:28
@liuhou
這個是典型的大小波問題，你看下VDS是不是也是這樣子。

我測了，VDS也是一樣。我看VDS的波形，發(fā)現(xiàn)工作是一個CCM一個周期，DCM一個周期，這樣交替工作

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2011-04-22 16:29
@asouth
是不是有干擾信號進去了？PCB布局怎么樣？

我去改改試試

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asouth
LV.8
9
2011-04-22 16:49
@ope8363744
我測了，VDS也是一樣。我看VDS的波形，發(fā)現(xiàn)工作是一個CCM一個周期，DCM一個周期，這樣交替工作
Cs電容多大？改成680P或820P看看！
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ope8363744
LV.2
10
2011-04-22 16:54
@asouth
Cs電容多大？改成680P或820P看看！

餓。。。。我沒加。。。。我直接是從采樣電阻上直接連到了IC的CS口。限流電阻也沒加

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asouth
LV.8
11
2011-04-22 17:20
@ope8363744
餓。。。。我沒加。。。。我直接是從采樣電阻上直接連到了IC的CS口。限流電阻也沒加[圖片]

加1K與471再試一試！

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ope8363744
LV.2
12
2011-04-23 13:46
@asouth
加1K與471再試一試！

依然一樣

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asouth
LV.8
13
2011-04-23 15:11
@ope8363744
依然一樣
把原理圖傳上來看看！
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ope8363744
LV.2
14
2011-04-23 17:04
@asouth
把原理圖傳上來看看！

  

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asouth
LV.8
15
2011-04-24 09:34
@ope8363744
[圖片][圖片]  

R5是1.2K還是12K?R5換成1K,C6換成680P,R40R41R42R43就用一個1R的取樣電阻,試試!還有輸出電感L2是80UH?改成8UH看看.

 

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liuhou
LV.9
16
2011-04-24 17:05
@asouth
R5是1.2K還是12K?R5換成1K,C6換成680P,R40R41R42R43就用一個1R的取樣電阻,試試!還有輸出電感L2是80UH?改成8UH看看. 
看看有沒有效果。。
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2011-04-24 20:23
@ope8363744
我把電流做小 這個毛刺就能消除。。。。
電流做小，進入DCM模式，所以振蕩消失。
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2011-04-24 20:24
樓主，你的這個應該是次諧波振蕩了，加斜坡補償吧。
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ope8363744
LV.2
19
2011-04-25 13:57
@asouth
R5是1.2K還是12K?R5換成1K,C6換成680P,R40R41R42R43就用一個1R的取樣電阻,試試!還有輸出電感L2是80UH?改成8UH看看. 

你好，R5是1.2K，C6是1000P   ，R40R41R42R43用一個1R的 電流根本上不去。我設計的時候峰值電流有3A多。L2我沒加

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zhenxiang
LV.10
20
2011-04-25 14:01
@高等數(shù)學
樓主，你的這個應該是次諧波振蕩了，加斜坡補償吧。

按說這個是可以控制在占空比小于0.5的 懷疑是布板原因導致干擾到電流取樣

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ope8363744
LV.2
21
2011-04-25 14:58
@zhenxiang
按說這個是可以控制在占空比小于0.5的懷疑是布板原因導致干擾到電流取樣

占空比是小于0.5的。大波占空比大約35%，小波5%左右

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asouth
LV.8
22
2011-04-25 15:21
@ope8363744
你好，R5是1.2K，C6是1000P  ，R40R41R42R43用一個1R的電流根本上不去。我設計的時候峰值電流有3A多。L2我沒加
60W峰值電流有3A多?我的12V5A設計的時候好象沒怎么大？我用0.5R的.
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ope8363744
LV.2
23
2011-04-25 17:02
@asouth
60W峰值電流有3A多?我的12V5A設計的時候好象沒怎么大？我用0.5R的.
   我不太會設計變壓器，就自己邊學邊弄的
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zhenxiang
LV.10
24
2011-04-25 21:56
@ope8363744
占空比是小于0.5的。大波占空比大約35%，小波5%左右

建議上傳版圖看下，  具體看下芯片的定頻引腳和電流取樣引腳處得布線

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2011-04-25 22:01
@ope8363744
占空比是小于0.5的。大波占空比大約35%，小波5%左右
那你頂樓的圖畫的就不準確了。
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mjun
LV.7
26
2011-08-06 11:59

樓主，你在調試的時候有沒有出現(xiàn)變壓器嘯叫的情況？如何解決這個問題？

 

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