請(qǐng)問關(guān)于to246的測試

將連在c腳上的電壓增大的時(shí)候,輸出的占空比也隨之增大,而且可以達(dá)到100%,可是按照datasheet上的說明占空比應(yīng)該是隨電流增大而減小,而且最高只能到78%.
而且不論v1和v2哪個(gè)先上開始DS兩端都沒有波形,只有上電后將C,S短路波形才能出來.
請(qǐng)問是什么原因阿?
如圖:

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powerint_tny

LV.5

2007-07-17 14:54

top是通過檢測流進(jìn)C腳的電流來調(diào)整輸出的.輸出的最大占空比是78%,你的調(diào)試電路有問題.一是電容要接在C腳上,另R7的電阻太小.加大到1.5K

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warlock

LV.2

2007-07-17 17:27

@powerint_tny

top是通過檢測流進(jìn)C腳的電流來調(diào)整輸出的.輸出的最大占空比是78%,你的調(diào)試電路有問題.一是電容要接在C腳上,另R7的電阻太小.加大到1.5K

都改過來了,D還是隨V2增加而增加
V2從7.2v到14v調(diào)節(jié)時(shí),D從25%到100%增加,當(dāng)V2小于7.2v,D跳變?yōu)?輸出關(guān)斷,而且無法重啟,即使再將V2調(diào)高,D依然為0;當(dāng)V2大于14V,D到100%后,電壓往下調(diào),D也可以隨之變小.

回復(fù)

powerint_emi

LV.8

2007-07-18 09:34

@warlock

都改過來了,D還是隨V2增加而增加V2從7.2v到14v調(diào)節(jié)時(shí),D從25%到100%增加,當(dāng)V2小于7.2v,D跳變?yōu)?輸出關(guān)斷,而且無法重啟,即使再將V2調(diào)高,D依然為0;當(dāng)V2大于14V,D到100%后,電壓往下調(diào),D也可以隨之變小.

你的圖畫錯(cuò)了,C3和C4

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powerint_emi

LV.8

2007-07-18 09:38

@powerint_emi

你的圖畫錯(cuò)了,C3和C4

請(qǐng)參考下面的圖

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powerint_emi

LV.8

2007-07-18 09:39

@powerint_emi

請(qǐng)參考下面的圖

500) {this.resized=true; this.width=500; this.alt='這是一張縮略圖，點(diǎn)擊可放大。\n按住CTRL，滾動(dòng)鼠標(biāo)滾輪可自由縮放';this.style.cursor='hand'}" onclick="if(!this.resized) {return true;} else {window.open('http://u.dianyuan.com/bbs/u/55/949531184722761.jpg');}" onmousewheel="return imgzoom(this);">