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LinkSwitch-XT的漏極與其他管腳的高壓漏電要求是如何保證的

LinkSwitch系列內(nèi)部都是含有一個(gè)高壓功率mosfet，其中漏極也是在開(kāi)啟及穩(wěn)態(tài)工作時(shí)提供內(nèi)部操作電流，以LinkSwitch-XT為例，是如何保證高壓漏極與其它所有引腳之間滿足高壓漏電要求的？必須在PCB板上和封裝上都要滿足漏電要求才可以吧，對(duì)于最大漏極電壓和最大漏極電流是否也和高壓漏電要求有關(guān)？

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gdhe342
LV.9
2
2016-12-09 21:56

我發(fā)現(xiàn)無(wú)論哪種封裝，它的漏極D都是隔離開(kāi)的，也就是封裝上比常規(guī)少一個(gè)管腳，這應(yīng)該也是來(lái)保證漏電電壓要求的么？

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fordfiash
LV.9
3
2016-12-14 21:34
依賴(lài)漏極節(jié)點(diǎn)電容來(lái)控制漏感引起的峰值漏極源極電壓
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fordfiash
LV.9
4
2016-12-14 21:35
@fordfiash
依賴(lài)漏極節(jié)點(diǎn)電容來(lái)控制漏感引起的峰值漏極源極電壓
最大輸入電壓、漏感能量以及初級(jí)繞組電容決定了峰值漏極電壓
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opingss88
LV.10
5
2016-12-15 17:01
@gdhe342
[圖片][圖片]我發(fā)現(xiàn)無(wú)論哪種封裝，它的漏極D都是隔離開(kāi)的，也就是封裝上比常規(guī)少一個(gè)管腳，這應(yīng)該也是來(lái)保證漏電電壓要求的么？
沒(méi)錯(cuò)，這個(gè)應(yīng)該是防止管腳間距以及短路的 發(fā)生，刻意封裝時(shí)候留了一個(gè)空位腳
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gdhe342
LV.9
6
2016-12-16 14:42
@opingss88
沒(méi)錯(cuò)，這個(gè)應(yīng)該是防止管腳間距以及短路的發(fā)生，刻意封裝時(shí)候留了一個(gè)空位腳
短路我覺(jué)得一般到不會(huì)，就是距離短了怕有漏電和回路，返到漏級(jí)就麻煩大了
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erecing
LV.9
7
2016-12-16 22:43
漏電要求是芯片本身的制造工藝決定的，只要按照規(guī)定的pcb布局要求設(shè)計(jì)就ok
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erecing
LV.9
8
2016-12-16 22:45
@gdhe342
短路我覺(jué)得一般到不會(huì)，就是距離短了怕有漏電和回路，返到漏級(jí)就麻煩大了
貌似這種封裝在LinkSwitch的其他系列里面也是這樣的，看來(lái)對(duì)于D級(jí)隔離還是需要的
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2016-12-17 23:11
@gdhe342
[圖片][圖片]我發(fā)現(xiàn)無(wú)論哪種封裝，它的漏極D都是隔離開(kāi)的，也就是封裝上比常規(guī)少一個(gè)管腳，這應(yīng)該也是來(lái)保證漏電電壓要求的么？
漏極的布線感覺(jué)比較細(xì)，是因?yàn)樾枰ＷC安全距離的原因么
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yogong2000
LV.4
10
2016-12-17 23:12
@erecing
貌似這種封裝在LinkSwitch的其他系列里面也是這樣的，看來(lái)對(duì)于D級(jí)隔離還是需要的
這種缺腳封裝只在電源類(lèi)的芯片上看到過(guò)，pi的好多系列都是這樣
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truim333
LV.9
11
2016-12-18 15:53
最大漏極電壓是用來(lái)校驗(yàn)在最高輸入電壓和峰值輸出功率時(shí)VDS沒(méi)有超過(guò)mosfet耐壓值
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truim333
LV.9
12
2016-12-18 15:54
@truim333
最大漏極電壓是用來(lái)校驗(yàn)在最高輸入電壓和峰值輸出功率時(shí)VDS沒(méi)有超過(guò)mosfet耐壓值
最大漏極電流是檢測(cè)電源開(kāi)啟時(shí)是否出現(xiàn)過(guò)高的前沿導(dǎo)通電流尖
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h547515318
LV.6
13
2017-01-05 13:57
PI的電源芯片都是小功率輸出的，LinkSwitch系列也是小功率LED上面用的比較多。
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a2512848524
LV.8
14
2017-01-11 08:55
本來(lái)是8腳的貼片間距比較小，為了加大D和S腳之間漏電距離還特地少放一個(gè)引腳。
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